开发者发布内置RISC-V CPU的实验模型Qwenputer
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开发者发布内置RISC-V CPU的实验模型Qwenputer
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AI 综述
开发者 Divyansh Agrawal 于 10 月 22 日发布实验性开源模型 Qwenputer：基于阿里 Qwen3.5-4B，将 RISC-V 的 RV32IM 指令集编译进模型权重，并用门控 DeltaNet 注意力层内部状态充当 RAM，使 CPU 完全运行在模型前向传播内，可执行算术和 C、MicroPython 代码，无需 Python 等外部工具或任何外部运行时。 项目已在 Hugging Face 和 GitHub 开源，可在配备 24GB 显存的单张 GPU 上运行，但需要专用驱动，不能像普通大模型那样直接加载。
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最新进展10月30日 14:12
开发者发布实验性模型 Qwenputer，在 Qwen3.5-4B 内实现可执行 RISC-V CPU报道时间线
沿着报道，了解事件的不同侧面。
10月30日
- IT之家开发者发布实验性模型 Qwenputer，在 Qwen3.5-4B 内实现可执行 RISC-V CPU
开发者 Divyansh Agrawal 于 10 月 22 日发布实验性开源模型 Qwenputer，基于阿里 Qwen3.5-4B，将 RISC-V 的 RV32IM 指令集编译进模型权重，并利用门控 DeltaNet 内部状态充当 RAM，无需外部工具即可执行程序和精确计算。
- 开源中国资讯Qwenputer：开发者在 Qwen 3.5 4B 权重里编译 RISC-V CPU，用注意力层当内存
开发者 Divyansh Agrawal 发布了 Qwenputer，在 Qwen 3.5 4B 的权重里编译了一颗 RISC-V CPU，并用模型自身的 Gated DeltaNet 注意力层充当内存。CPU 完全运行在模型前向传播内，可执行算术、运行 C 和 MicroPython 代码，不依赖插件、工具调用、沙箱或任何外部运行时。原文仅提供了原理开头的摘要，细节待完整正文。
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